FタイルJESD204C インテル® FPGA IPデザイン例のユーザー ガイド

ID 691269
日付 9/27/2022
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ドキュメント目次

3.5. System Consoleのコントロール・デザイン例のハードウェア・テスト

インテル® Quartus® PrimeソフトウェアでSystem Consoleコントロールを使用してデザイン例のハードウェア・テストを実行するには、次の手順を実行します。
注: このハードウェア・テストは、System Console制御用にデュプレックス・モードでデザインを構成したことを前提としています。シンプレックス・モード・デザインを使用している場合は、独自の変更を行います。
  1. インテル® Quartus® Prime (Tools > System Debugging Tools > System Console)からSystem Consoleのツールを起動します。
  2. TCL Consoleコマンドプロンプトに、タイプ get_service_paths マスター JTAG チェーンに接続されているデバイスのリストを出力します。
  3. 任意のテキストエディターでed/hwtest/ディレクトリーにある main.tclスクリプトを開き、次の行を見つけます。
    set master_index [expr {$master_list_length - 1}]
  4. 必要に応じてmaster_indexオフセットを調整して、master_indexが常に Intel® Agilex™ デバイスを指し、ファイルを保存するように JTAGチェーン・コンフィグレーションを反映させます。
    図 10. JTAG チェーンを反映するための master_indexコンフィグレーションの例
  5. TCL Consoleのコマンドプロンプトで、 ed/hwtest/ディレクトリ (cd../ed/hwtest/) に移動し、main.tcl スクリプト (ソース main.tcl) を実行します。TCL Consoleウィンドウは次の図のようになります。
    図 11. ソース main.tcl
  6. コマンドプロンプトでstart_basic_testと入力して、リンクのセットアップとテスト手順を実行します。

    この手順では、一連の命令を実行して、TX および RX の sysref を定期的に設定し、PRBS パターンをチェックし、F-Tile Ethernet IP PHY 内部シリアル・ループバック モードを構成し、リンク ステータスを報告します。

    次の図は、データレートが 24.33024 Gbps の L=8、M=2、および F=1 のバリアントのリンク・セット・アップとテストの成功から予想される結果を示しています。
    図 12. System Consoleでのテストの成功
    表 21.  main.tcl System Console スクリプトの手順次の表は、 main.tcl デバッグに役立つ場合があります。
    プロシージャー 説明
    get_service_paths {master} JTAG チェーンに接続されているすべてのデバイスを報告します。この情報を使用して、マスタ・インデックスが Intel® Agilex™ デバイスを指すように設定します。
    get_master_index N/A ターゲットデバイスのマスター・インデックスを設定します。get_service_pathsマスターを使用してJTAG チェーン内の Intel® Agilex™ デバイスのオフセットを特定し、それに応じてこの手順でオフセットを編集します。
    start_basic_test N/A 一連の命令を実行して TX と RX のSYSREFを定期的に設定し、PRBS パターンをチェックし、F-Tile Ethernet IP PHY 内部シリアル・ループバック モードを構成し、PMA を構成し、リンクステータスをレポートします。
    リセット N/A グローバルリセット
    xcvr_lpbk <0.1

    0: 内部シリアル・ループバックをディセーブルします。

    1: 内部シリアル・ループバックをイネーブルします。

    テストモード prbs7、prbs9、prbs15、prbs23

    ramp: パターン・ジェネレーターとチェッカーをランプパターンに設定します。

    prbs7-23: パターン・ジェネレーターとチェッカーをそれぞれの PRBS パターンに設定します。

    sysref_type {oneshot, periodic, gperiodic } SYSREF タイプを設定します。
    eval_test N/A

    1. ステータスを読み込みます。

    2. レーンごとにチェックします。

    3. TX および RX レジスターの値を示します。

    • rst_sts0:
      • Bit 0 – CORE PLL LOCKED
    • rx_status3:
      • Bit 0-15 – RX CDR LOCKED
    • rx_status4:
      • Bit 0-15 – SH LOCKED

    • rx_status5:
      • Bit 0-15 – EMB LOCKED
    • tst_err0:
      • Bit 0 – PATTERN CHECKER ERROR
      • Bit 1 – TX LINK ERROR
      • Bit 2 – RX LINK ERROR
      • Bit 3 – COMMAND PATTERN CHECKER ERROR
    read_err_status N/A リード・ステータス・レジスター
    clear_err_status N/A F-Tile Ethernet IPエラー・ステータ・スレジスターをクリアします。
    read_rx_status0 N/A F-Tile Ethernet IP rx_status0 レジスターを読み込みます。
    read_tx_status0 N/A F-Tile Ethernet IP tx_status0 レジスターを読み込みます。
    read_rx_syncn_sysref_ctrl N/A F-Tile Ethernet IP syncn_sysref_ctrl レジスターを読み込みます。
    wait_seconds {integer} {integer} 秒間待機します。
    wait_minutes {integer} {integer} 分間待機します。