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1. Intel® Agilex™ コンフィグレーション・ユーザーガイド
2. Intel® Agilex™ コンフィグレーションの詳細
3. Intel® Agilex™ のコンフィグレーション・スキーム
4. Intel® FPGA IPデザインでリセットリリースを含む
5. リモート・システム・アップデート (RSU)
6. Intel® Agilex™ のコンフィグレーション機能
7. Intel® Agilex™ のデバッグガイド
8. Intel® Agilex™ コンフィグレーションのユーザーガイドのアーカイブ
9. Intel® Agilex™ コンフィグレーションのユーザーガイドのドキュメントの改訂履歴
3.2.1. ASコンフィグレーション・スキームのハードウェア・コンポーネントとファイルの種類
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用するAS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. 最大許容外部AS_DATAピンスキュー遅延ガイドライン
3.2.6. シリアル・フラッシュ・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリーのレイアウト
3.2.8. AS_CLK
3.2.9. アクティブ・シリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Primeのプログラミング手順
3.2.11. ASコンフィグレーション・スキームのデバッグガイドライン
3.2.12. ASコンフィグレーションのピン・アサインメント
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5.4.1.3. RSUイメージレイアウト–御社の視点
Tブパーティション・テーブル(SPT)は、クアッドSPIフラッシュを管理します。
インテル® Quartus® Prime Programming File Generatorは、最初の製造イメージを作成するときにSPTを作成します。 信頼性の高い操作を保証するために、Programming File Generatorは、サブパーティション・テーブルとコンフィグレーション・ポインター・ブロックの2つのコピー、SPT0とSPT1、およびCPB0とCPB1を作成します。
The initial RSU image stored in flash typically contains the following partitions:フラッシュに保存されている最初のRSUイメージには、通常、次のパーティションが含まれています。
サブパーティション名 | 目次 |
---|---|
BOOT_INFO | 決定ファームウェアおよび決定ファームウェア・データ |
FACTORY_IMAGE | ファクトリー・イメージ |
SPT0 | サブパーティションテーブル0 |
SPT1 | サブパーティションテーブル1 |
CPB0 | ポインターブロック0 |
CPB1 | ポインターブロック1 |
P1 (you enter) | アプリケーション・イメージ1 |
P2 (you enter) | アプリケーション・イメージ2 |
図 69. RSU Image Layout - Your PerspectiveIn this figure:
- SPT0 and SPT1 point to everything:
- BOOT_INFO
- Factory Image
- Pointer Block 0 and Pointer Block 1
- All Application Images
- Pointer Block 0 and Pointer Block 1 point to all Application Images
要約すると、フラッシュメモリーのビューはSDMビューと2つの点で異なります。
- 決定ファームウェアのアドレス、決定ファームウェア・データ、およびファクトリー・イメージを知る必要はありません。
- サブパーティション・テーブルにアクセスできます。サブパーティション・テーブルは、リモート・システム・アップデートに必要なデータ構造へのアクセスを提供します。