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3.3.4. JTAGコンフィグレーション・スキームのデバッグ・ガイドライン
JTAGコンフィグレーション・スキームは、他のすべてのコンフィグレーション・スキームをオーバーライドします。 セキュリティー機能がJTAGインターフェイスを無効にしない限り、SDMは常にJTAGを介した設定を受け入れる準備ができています。 JTAGは、破損したイメージを使用して設定しようとしたときに到達できない回復不能な状態にある可能性のあるデバイスを回復する場合に特に役立ちます。
nCONFIG立ち下がりエッジは、JTAGアクセスを終了し、デバイスはMSELで指定されたブートソースに戻ります。nCONFIGは、JTAG設定中は安定している必要があります。nSTATUSは、JTAGコンフィグレーション中にnCONFIGの後に続きます。 したがって、nSTATUSも安定している必要があります。
他のコンフィグレーション・スキームとは異なり、JTAGのコンフィグレーション中にエラーが発生した場合、nSTATUSはアサートしません。 エラー報告のために インテル® Quartus® Primeプロ・エディションが生成するエラーメッセージを監視する必要があります。
デバッグの提案
JTAGのデバッグのヒントは次のとおりです。
- JTAGピンの接続が正しいことを確認します。
- JTAG設定が失敗する場合は、FPGAの電源が正常にオンになり、PORが終了したことを確認してください。 1つの戦略は、nCONFIGをLowに駆動し、nSTATUSもLowになるようにすることで、nCONFIGとnSTATUSの間のハンドシェイク動作をチェックすることです。
- JTAG設定中にnCONFIGピンの状態が変化しないことを確認します。
- デバイスがPOR状態を終了したかどうかを判断する別の方法は、 インテル® Quartus® Primeを使用してデバイスを検出することです。 プログラマーが Intel® Agilex™ デバイスを検出できる場合、デバイスはPOR状態を終了しています。
- インテル® FPGAダウンロード・ケーブルIIを使用している場合、ケーブルクロック速度を6 MHzに下げます。
- JTAGチェーンに複数のデバイスがある場合は、他の Intel® Agilex™ デバイスをJTAGチェーンから切断して、デバイスを分離してみてください。
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If you specify the OSC_CLK_1 as the clock source for configuration, ensure that OSC_CLK_1 is running at the frequency you specify in the インテル® Quartus® Prime software. 設定のクロックソースとしてOSC_CLK_1を指定する場合、 インテル® Quartus® Primeソフトウェアで指定した周波数でOSC_CLK_1が実行されていることを確認してください。
- High Bandwidth Memory（HBM2）IPまたはトランシーバーを使用するIPを含むデザインの場合、デバイスのコンフィグレーションを開始する前に、フリーランニングで安定した基準クロックをデバイスに提供する必要があります。 コンフィグレーションを開始する前に、すべてのトランシーバー電源装置が必要な電圧になっている必要があります。
- PCBのMSEL設定がJTAGでない場合、ASまたは Avalon® -STインターフェイスを使用した初期再コンフィグレーション後にリコンフィグレーションにJTAGインターフェイスを使用する場合、.sofは インテル® Quartus® Primeプロジェクトで指定したファイル形式である必要があります。 たとえば、最初にASコンフィグレーション用にMSELピンをコンフィグレーションし、ASスキームを使用してこんふぃした場合、 Avalon® -ST用に生成された.sofを使用した後続のJTAGリコンフィグレーションは失敗します。
- JTAGのリコンフィグレーション後にRSU_STATUSコマンドをクリアするかどうかは、 インテル® Quartus® Primeソフトウェア・バージョンによって異なります。 以前の インテル® Quartus® Primeのソフトウェア・バージョンでは、JTAGのリコンフィグレーション後にRSU_STATUSがクリアされません。 インテル® Quartus® Prime 20.3バージョン以降、システムはJTAGのリコンフィグレーション後にRSU_STATUSをクリアします。
- 電源投入時に、外部コンポーネントがnSTATUS信号をLowに駆動しないことを確認してください。