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1.5.1. サポートされているデバイスとシグナリング
1.5.2. HSPICEシミュレーション・キットへのアクセス
1.5.3. HSPICEシミュレーションにおけるダブルカウント問題
1.5.4. HSPICE Writerツールのフロー
1.5.5. HSPICEシミュレーションの実行
1.5.6. 出力シミュレーションの結果の解釈
1.5.7. 入力シミュレーションの結果の解釈
1.5.8. 表形式のシミュレーション結果の表示および解釈
1.5.9. グラフ形式のシミュレーション結果の表示
1.5.10. HSPICEシミュレーションに基づいたデザインの調整
1.5.11. I/O HSPICEシミュレーション・デッキのサンプル入力
1.5.12. I/O HSPICEシミュレーション・デッキのサンプル出力
1.5.13. 高度なトピック
1.5.12.1. Header Comment
1.5.12.2. Simulation Conditions
1.5.12.3. Simulation Options
1.5.12.4. Constant Definition
1.5.12.5. I/O Buffer Netlist
1.5.12.6. Drive Strength
1.5.12.7. スルーレートと遅延チェーン
1.5.12.8. I/O Buffer Instantiation
1.5.12.9. Board and Trace Termination (ボードおよびトレース終端)
1.5.12.10. Double-Counting Compensation Circuitry (ダブルカウント補正回路)
1.5.12.11. Simulation Analysis
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1.3.4. サードパーティー・ツールでのシミュレーションのセットアップと実行
ファイルの生成後、それらファイルを使用して選択したシミュレーション・ツールでシミュレーションを実行することができます。
IBISモデルの場合、入力、出力、および双方向のバッファー・エンティティーにファイルを適用し、シミュレーションを迅速にセットアップして実行することができます。HSPICEデッキの場合、シミュレーション・パラメーターはファイルに含まれています。このファイルを Synopsys* HSPICEで開き、必要に応じて各ピンのシミュレーションを実行します。
HSPICE Writerから生成されたHSPICEデッキの場合、ダブルカウント問題が考慮されているため、シミュレーションが正確であることが保証されます。 インテル® Quartus® Prime開発ソフトウェアのデフォルトの負荷設定以外で作成されたIBISモデルを含むシミュレーションは、IBIS遅延と インテル® Quartus® Prime tCO測定間の負荷のサイズの変更を考慮する必要があります。コンパイル時の警告メッセージは、この変更を警告します。