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2.1.3. 第1ステージ・ブートローダー
第1ステージ・ブートローダー (FSBL) は、HPSの最初のブートステージです。FPGA Configuration Firstモードでは、SDMはFSBLを抽出してHPSのオンチップRAMにロードします。FPGAがユーザーモードに入った後、SDMはHPSをリセットから解放します。HPSはリセットを終了した後、FSBLハードウェア・ハンドオフ・ファイルを使用して、クロック、HPS専用I/O、およびペリフェラルをセットアップします。通常、FSBLはSSBLをHPS SDRAMにロードし、制御をSSBLに渡します。
FSBLは、次のいずれかのソースから作成できます。
- U-Bootセカンダリー・プログラム・ローダー (SPL)
- インテルでは、GitHubでU-Bootのソースコードを提供しています。
- ARM* Trusted Firmware
- インテルでは、GitHubで ARM* Trusted Firmwareのソースコードを提供しています。