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1. Intel Agilex® 7 FPGA FシリーズおよびIシリーズのクロッキングおよびPLLの概要
2. FシリーズおよびIシリーズのクロッキングおよびPLLのアーキテクチャーと機能
3. FシリーズおよびIシリーズのクロッキングおよびPLLのデザインの考慮事項
4. Clock Control Intel FPGA IPコア
5. IOPLL Intel FPGA IPコア
6. IOPLL Reconfig Intel FPGA IPコア
7. Intel Agilex 7のクロッキングおよびPLLユーザーガイド: FシリーズおよびIシリーズのアーカイブ
8. Intel Agilex® 7クロッキングおよびPLLユーザーガイドの文書改訂履歴
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6.5.1.2. リップルキャップ用のデータバスの設定
Multiply Factor 17 | Ripplecap Setting Address = 00001010 Data [2:1] |
||
---|---|---|---|
低帯域幅 | 中帯域幅 | 高帯域幅 | |
4–5 | 2'b01 | 2'b01 | 2'b00 |
6–7 | 2'b11 | 2'b01 | 2'b01 |
8–10 | 2'b11 | 2'b01 | 2'b01 |
11–15 | 2'b11 | 2'b01 | 2'b01 |
16–20 | 2'b11 | 2'b01 | 2'b01 |
21–23 | 2'b11 | 2'b01 | 2'b01 |
24–43 | 2'b11 | 2'b01 | 2'b01 |
44–64 | 2'b11 | 2'b01 | 2'b01 |
65–85 | 2'b11 | 2'b01 | 2'b01 |
86–124 | 2'b11 | 2'b01 | 2'b01 |
125–160 | 2'b11 | 2'b01 | 2'b01 |
Multiply Factor 17 | Ripplecap Setting Address = 00001010 Data [2:1] |
|
---|---|---|
中帯域幅 | 高帯域幅 | |
4–5 | 2'b01 | 2'b00 |
6–7 | 2'b01 | 2'b00 |
8–10 | 2'b01 | 2'b01 |
11–15 | 2'b01 | 2'b01 |
16–20 | 2'b01 | 2'b01 |
21–23 | 2'b01 | 2'b01 |
24–43 | 2'b01 | 2'b01 |
44–64 | 2'b01 | 2'b01 |
65–85 | 2'b01 | 2'b01 |
86–104 | 2'b01 | 2'b01 |
105–140 | 2'b01 | 2'b01 |
141–160 | 2'b01 | 2'b01 |
17 NormalまたはSource SynchronousでUse Nondedicated Feedback Pathオプションを選択した場合、Multiply Factorは M x C i になります。ここで、M は M カウンター値、C i はCompensated Outclk C カウンター値です。それ以外の場合、Multiply Factorは M カウンター値のみになります。