F-Tile JESD204C インテル® FPGA IPユーザーガイド

ID 691272
日付 4/26/2022
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ドキュメント目次

4.7. FタイルJESD204C IPデザインのコンパイル

FタイルJESD204C IPコアのデザインをコンパイルする前に、FタイルJESD204C Intel FPGA IPを使用したデザイン を参照してください。

デザインをコンパイルするには、 インテル® Quartus® Prime開発ソフトウェアのProcessingメニューでStart Compilationをクリックします。生成された .ip または .qip ファイルを使用して、関連ファイルをプロジェクトに含めることができます。