AN 813: PCI Express* リファレンス・デザインを使用した Arria® 10デバイスの階層的なパーシャル・リコンフィグレーション

ID 683730
日付 9/24/2018
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ドキュメント目次

1.3.1.3.4. Arria® 10 パーシャル・リコンフィグレーション・コントローラーIPコア

Arria® 10 パーシャル・リコンフィグレーション・コントローラーIPコアを使用して、PRリージョンへのフリーズリクエストを開始します。PRリージョンは、フリーズリクエストの確認応答ですべての動作を終了させます。フリーズブリッジは、PRリージョンへのAvalon-MMインターフェイスを停止し、パーシャル・リコンフィグレーション中にPRリージョンに向けて作成されたトランザクションに対し適切に応答します。PR完了時に、リージョン・コントローラーは停止リクエストを発行し、リージョンが確認応答し、適切に動作することを可能にします。このリファレンス・デザインで提供されるfpga-region-controllerプログラムはこれらの機能を実行します。

リファレンス・デザインは、パーシャル・リコンフィグレーション・リージョン・コントローラーIPコアを内部ホストとして動作するようにコンフィグレーションします。デザインは、Avalon-MMインターフェイスのインスタンスを介してこのIPコアを PCI Express* IPコアに接続します。このPR IPコアのクロック対データ比は1です。よって、PR IPコアは、暗号化または圧縮されたPRデータを処理できません。

次の表に、プリセット設定とは異なる PCI Express* IPコア用の Arria® 10 ハードIPのコンフィグレーション・フィールドをリストします。

パラメーター
Enable JTAG debug mode Disable
Enable Avalon-MM slave interface Enable
Input data width 32