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1.3.1.1. PCI Express* IPコア
PCI Express* IPコア用の Arria® 10ハードIPはGen3x8で、256ビットのインターフェイスを備えており、250 MHzで動作します。
次の表は、リファレンス・デザインが使用するデフォルトの設定とは異なる PCI Express* IPのパラメーターのコンフィグレーション・フィールドの情報を提供します。
| 設定 | パラメーター | 値 |
|---|---|---|
| System Settings | Application interface type | DMAを備えたAvalon-MM |
| Hard IP mode | Gen3:x8、インターフェイス: 256ビット、250 MHz | |
| Port type | ネイティブ・エンドポイント | |
| RX buffer credit allocation for received requests vs completions | Low | |
| Avalon-MM Settings | Enable control register access (CRA) Avalon-MM slave port | ディセーブル |
| Base Address Registers - BAR2 | Type | 32ビットのプリフェッチ不可能なメモリー |
| Base Address Registers - BAR4 | Type | 32ビットのプリフェッチ不可能なメモリー |
| Device Identification Registers | Vendor ID | 0x00001172 |
| Device ID | 0x00005052 | |
| Revision ID | 0x00000001 | |
| Class code | 0x00ea0001 | |
| Subsystem Vendor ID | 0x00001172 | |
| Subsystem Device ID | 0x00000001 | |
| PCI Express/PCI Capabilities - Device | Maximum payload size | 256バイト |
| Configuration, Debug, and Extension Options | Enable Arria® 10 GX FPGA Development Kit Connection | Enable |
| PHY Characteristics | Requested equalization far-end TX preset | Preset 9 |
注: PCI Express* IPコアをPlatform Designerシステムの一部として初期化します。