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1. Intel Agilex® 7コンフィグレーション・ユーザーガイド
2. Intel Agilex® 7コンフィグレーションの詳細
3. Intel Agilex® 7コンフィグレーション手法
4. デザインにリセットリリース インテル® FPGA IPを含める
5. Remote System Update (RSU)
6. Intel Agilex® 7コンフィグレーション機能
7. Intel Agilex® 7 デバッグガイド
8. Intel Agilex® 7 IPユーザーガイド・アーカイブ
9. Intel Agilex® 7のコンフィグレーション・ユーザーガイドの文書改訂履歴
3.1.1. Avalon® -ST コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイル タイプ
3.1.2. Avalon-ST デバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングル・デバイス・コンフィグレーション
3.1.6. Avalon® -ST コンフィグレーション・スキームのデバッグ・ガイドライン
3.1.7. Avalon® -ST コンフィグレーション・スキームで使用する IP : Intel FPGA パラレル・フラッシュ・ローダ II IP コア
3.2.1. AS コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用する AS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. スキュー許容ガイドライン
3.2.6. シリアル・フラッシュ・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリーのレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. AS コンフィグレーション・スキームのデバッグ・ガイドライン
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7.8. コンフィグレーション・ピンの動作の理解とトラブルシューティング
通常、コンフィグレーションは次のいずれかの理由で失敗します。
- ホストがタイムアウトする
- コンフィグレーション・データエラーが発生する
- 外部イベントがコンフィグレーションを中断しする
- 内部エラーが発生する
コンフィグレーション・エラーの非常に一般的な原因は次のとおりです。
-
OSC_CLK_1の周波数を確認します。 これは、 インテル® Quartus® Primeソフトウェアで指定した周波数とボード上のクロックソースに一致する必要があります。
- トランシーバー、PCIe、または HBM2 を使用するデザインにフリーランニング基準クロックが存在することを確認します。これらの基準クロックは、デバイスがユーザーモードに入るまで使用可能である必要があります。
- HPSと外部メモリー インターフェイス(EMIF)を使用するデザインの場合、EMIFクロックが存在することを確認してください。
- SmartVID(-Vおよび-Eデバイス)を使用するデザインの場合、この機能が正しく設定され、動作していることを確認してください。電圧レギュレータがSmartVIDをサポートしていることを確認してください。
コンフィグレーション・モードに適用されるデバッグの提案を次に示します。
- OSC_CLK_1の問題を除外するには、 インテル® Quartus® Primeで Internal Oscillatorオプションを選択します。
- IP を含まない単純なデザインで Intel Agilex® 7デバイスを構成してみてください。非 JTAG 方式によるコンフィギュレーションが単純なデザインで失敗する場合は、MSELピンを JTAG に特別に設定してJTAGコンフィギュレーションを試してください。
次のトピックでは、コンフィグレーション・ピンの予想される動作について説明します。さらに、これらのトピックは、コンフィグレーションの失敗のデバッグに役立ついくつかの提案を提供します。特定のコンフィグレーション・スキームに関連するデバッグの提案については、各コンフィグレーション・スキームの個別のセクションを参照してください。