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1. Intel Agilex® 7コンフィグレーション・ユーザーガイド
2. Intel Agilex® 7コンフィグレーションの詳細
3. Intel Agilex® 7コンフィグレーション手法
4. デザインにリセットリリース インテル® FPGA IPを含める
5. Remote System Update (RSU)
6. Intel Agilex® 7コンフィグレーション機能
7. Intel Agilex® 7 デバッグガイド
8. Intel Agilex® 7 IPユーザーガイド・アーカイブ
9. Intel Agilex® 7のコンフィグレーション・ユーザーガイドの文書改訂履歴
3.1.1. Avalon® -ST コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイル タイプ
3.1.2. Avalon-ST デバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングル・デバイス・コンフィグレーション
3.1.6. Avalon® -ST コンフィグレーション・スキームのデバッグ・ガイドライン
3.1.7. Avalon® -ST コンフィグレーション・スキームで使用する IP : Intel FPGA パラレル・フラッシュ・ローダ II IP コア
3.2.1. AS コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用する AS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. スキュー許容ガイドライン
3.2.6. シリアル・フラッシュ・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリーのレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. AS コンフィグレーション・スキームのデバッグ・ガイドライン
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7.7. E タイル トランシーバーがコンフィグレーションに失敗することがある
完全に未使用の E タイルのトランシーバーにPRESERVE_UNUSED_XCVR_CHANNEL割り当てを行うと、 Intel Agilex® 7デバイスでコンフィグレーション・エラーが発生する可能性があります。
インテル Quartus Prime プログラマーは内部エラーを検出し、以下の条件下でデバイスのコンフィグレーションに失敗します。
- 未使用の E タイル全体にPRESERVE_UNUSED_XCVR_CHANNEL 割り当てを行いました。
- デザインは、この未使用の E タイルにリファレンス・クロックを提供していません。
基準クロックは、トランシーバーの経年劣化を防ぐために疑似ランダムデータ信号を生成するために必要です。 ネイティブ PHY IP GUI を使用して、E タイル内に少なくとも 1 つのダミーチャネルをインスタンス化する必要があります。 このチャネルに少なくとも 1 つの基準クロックを提供します。 単一の E タイル内のすべての保存チャネルは、同じ基準クロックを使用できます。
デザインが E タイル内の一部のチャネルを使用する場合、ピンごとのPRESERVE_UNUSED_XCVR_CHANNEL割り当てを使用して、使用する予定のチャネルのみを E タイル内に保持できます。 チャネルを使用する予定がない場合は、ピンごとのPRESERVE_UNUSED_XCVR_CHANNEL QSF 割り当てを追加しないでください。
PRESERVE_UNUSED_XCVR_CHANNEL割り当ての例をいくつか示します。
#Global QSF assignment set_global_assignment -name PRESERVE_UNUSED_XCVR_CHANNEL ON #Per-pin QSF assignment set_instance_assignment -name PRESERVE_UNUSED_XCVR_CHANNEL ON -to AA75
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