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1. Intel Agilex® 7コンフィグレーション・ユーザーガイド
2. Intel Agilex® 7コンフィグレーションの詳細
3. Intel Agilex® 7コンフィグレーション手法
4. デザインにリセットリリース インテル® FPGA IPを含める
5. Remote System Update (RSU)
6. Intel Agilex® 7コンフィグレーション機能
7. Intel Agilex® 7 デバッグガイド
8. Intel Agilex® 7 IPユーザーガイド・アーカイブ
9. Intel Agilex® 7のコンフィグレーション・ユーザーガイドの文書改訂履歴
3.1.1. Avalon® -ST コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイル タイプ
3.1.2. Avalon-ST デバイス・コンフィグレーションの有効化
3.1.3. AVST_READY信号
3.1.4. RBFコンフィグレーション・ファイル・フォーマット
3.1.5. Avalon-STシングル・デバイス・コンフィグレーション
3.1.6. Avalon® -ST コンフィグレーション・スキームのデバッグ・ガイドライン
3.1.7. Avalon® -ST コンフィグレーション・スキームで使用する IP : Intel FPGA パラレル・フラッシュ・ローダ II IP コア
3.2.1. AS コンフィグレーション・スキーム・ハードウェア・コンポーネントとファイルタイプ
3.2.2. ASシングル・デバイス・コンフィグレーション
3.2.3. 複数のシリアル・フラッシュ・デバイスを使用する AS
3.2.4. ASコンフィグレーション・タイミング・パラメーター
3.2.5. スキュー許容ガイドライン
3.2.6. シリアル・フラッシュ・デバイスのプログラミング
3.2.7. シリアル・フラッシュ・メモリーのレイアウト
3.2.8. AS_CLK
3.2.9. アクティブなシリアル・コンフィグレーション・ソフトウェアの設定
3.2.10. インテル® Quartus® Prime プログラミング手順
3.2.11. AS コンフィグレーション・スキームのデバッグ・ガイドライン
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1.1.1. 設定と関連信号
次の図は、コンフィグレーション・インターフェースとコンフィグレーション関連のデバイス機能を示しています。濃い青色で示されているピンは、専用の SDM I/O を使用しています。黒で示されているピンは、汎用 I/O (GPIO) を使用します。赤で示されているピンは、専用の JTAG I/O です。
SDM I/O ピン機能は、 インテル® Quartus® PrimeソフトウェアのDevice > Configuration > Device and Pin Options ダイアログボックスを使用して指定します。Y
図 1. Intel Agilex® 7 コンフィグレーション・インターフェース
このユーザー ガイドでは、図に示されているインターフェイスのほとんどについて説明します。 これらの機能の詳細については、別の Intel Agilex® 7 プロトコル経由のコンフィグレーション (CvP) 実装ユーザー ガイドおよび Intel Agilex® 7 電源管理ユーザーガイドを参照してください。