インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドライン

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ID 683417
日付 11/06/2017
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ドキュメント目次
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インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドライン
インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドライン x
インテル® Cyclone® 10 GX ピン接続ガイドライン インテル® Cyclone® 10 GXデバイスの電源共有ガイドライン インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドラインの改訂履歴
インテル® Cyclone® 10 GX ピン接続ガイドライン x
クロックおよび PLL ピン 専用コンフィグレーション / JTAG ピン オプショナル / 兼用コンフィグレーション・ピン 差動 I/O ピン 外部メモリー・インターフェイス・ピン 電圧センサーピン リファレンス・ピン 電源供給ピン トランシーバー・ピン インテル® Cyclone® 10 GXピン配置ガイドラインの備考
インテル® Cyclone® 10 GXデバイスの電源共有ガイドライン x
例 1— インテル® Cyclone® 10 GX 例 2— インテル® Cyclone® 10 GX
インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドライン

インテル® Cyclone® 10 GX デバイスファミリー・ピン接続ガイドラインの改訂履歴

表 12.  改訂履歴
日付 バージョン 変更内容
2017 年 11 月 2017.11.06
  • 本資料は現在暫定的ではありません。
  • VCCR_GXBとVCCT_GXBがVCCR_GXB[L1] [C,D]とVCCT_GXB[L1] [C,D] ピンの接続ガイドラインに同じ電圧レベルで供給する必要がある旨を追加。
  • VCCR_GXB[L1] [C,D] とVCCT_GXB[L1] [C,D] ピンの接続ガイドラインでサポートされる電圧レベルを更新。
  • VCCIO([2][A,J,K,L], [3][A,B]) ピンの接続ガイドラインを更新。
2017 年 6 月 2017.06.21
  • チップ - チップ間のアプリケーション向けの インテル® Cyclone® 10 GXのトランシーバー・データレート <= 12.5 Gbps ( パックプレーン・アプリケーション向けはトランシーバー・データレート <= 6.6 Gbps ) の電源共有ガイドラインを追加。
  • nPERSTL0 ピン名を更新。
  • RZQ_[#] ピンのピン機能と接続ガイドラインを更新。
  • CLKUSR ピンのピン機能を更新。
  • チップ間のアプリケーション向けのトランシーバー・データレート <= 11.3 Gbps の インテル® Cyclone® 10 GXにおける電源共有ガイドラインを追加。
  • チップ間のアプリケーション向けのトランシーバー・データレート <= 11.3 Gbps の インテル® Cyclone® 10 GXにおける電源共有ガイドラインを DisplayPort TX 電気的な完全な準拠に関する内容を追記し、追加。
  • 0.95V サポートをVCCERAMから削除。
  • パーシャル・リコンフィグレーションのサポートを削除。
2017 年 2 月 2017.02.13 初版
レベル 2 の表題