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1. High Bandwidth Memory (HBM2) Interface Intel FPGA IPについて
2. High Bandwidth Memory (HBM2) Interface Intel FPGA IPデザイン例 クイック・スタート・ガイド
3. High Bandwidth Memory (HBM2) Interface Intel FPGA IPデザイン例の説明
4. High Bandwidth Memory (HBM2) Interface インテル® FPGA IPデザイン例 ユーザーガイドのアーカイブ
5. High Bandwidth Memory (HBM2) Interface インテル® FPGA IPデザイン例 ユーザーガイドの改訂履歴
2.1. HBM2システム向け インテル® Quartus® Primeプロジェクトの作成
2.2. High Bandwidth Memory (HBM2) Interface Intel FPGA IPのコンフィグレーション
2.3. High Bandwidth Memory (HBM2) Interface Intel FPGA IP向けIP Parameter Editor Proのガイドライン
2.4. 合成可能なHigh Bandwidth Memory (HBM2) Interface Intel FPGA IPデザイン例の生成
2.5. 合成可能なHigh Bandwidth Memory (HBM2) Interface Intel FPGA IPの高効率生成
2.6. High Bandwidth Memory (HBM2) Interface Intel FPGA IPのシミュレーション用生成
2.7. High Bandwidth Memory (HBM2) Interface Intel FPGA IPデザイン例の変更後の再生成
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1.1. リリース情報
IPバージョンは、v19.1までは インテル® Quartus® Primeデザインスイートのソフトウェア・バージョンと同一です。 インテル® Quartus® Primeデザインスイートのソフトウェア・バージョン19.2以降のIPコアは、新しいIPバージョン管理スキームによります。
IPバージョン管理スキーム (X.Y.Z) 番号は、ソフトウェア・バージョンごとに変わります。
- Xの変更は、IPのメジャーリビジョンを示します。インテルQuartus Primeソフトウェアを更新したら、IPを再生成してください。
- Yの変更は、IPに新しい機能が含まれていることを示します。IPを再生成して、新しい機能を含めてください。
- Zの変更は、IPに新しい機能が含まれていることを示します。IPを再生成して、新しい機能を含めてください。
項目 | 説明 |
---|---|
IPバージョン | 19.2.0 |
インテル® Quartus® Primeバージョン | 19.2 |
リリース日 | 2019.07.01 |