AN 923: インテル® Stratix® 10 HPSペリフェラルのFPGAファブリックへの配線

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ID 683838
日付 10/12/2020
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ドキュメント目次
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1. AN 923: インテル® Stratix® 10 HPSペリフェラルのFPGAファブリックへの配線
1. AN 923: インテル® Stratix® 10 HPSペリフェラルのFPGAファブリックへの配線 x
1.1. FPGAへの配線をサポートしている インテル® Stratix® 10 HPSペリフェラル 1.2. FPGAへの インテル® Stratix® 10 HPS IPインターフェイスのデザイン例 1.3. AN 923: インテル® Stratix® 10 HPSペリフェラルのFPGAファブリックへの配線の改訂履歴
1.2. FPGAへの インテル® Stratix® 10 HPS IPインターフェイスのデザイン例 x
1.2.1. 前提条件 1.2.2. はじめに 1.2.3. Platform Designerでの初期HDLの生成 1.2.4. トップレベル・ファイルの変更 1.2.5. SPIM0のピンの割り当ての追加 1.2.6. ハードウェアのプログラミング・ファイルのコンパイルと生成 1.2.7. U-Bootの構築 1.2.8. QSPIイメージの準備 1.2.9. Linuxの構築 1.2.10. Yocto Rootfsの構築 1.2.11. spidevテストプログラムの構築 1.2.12. SDカードイメージの作成 1.2.13. ボードの起動 1.2.14. SPIM0のテスト
1.2.1. 前提条件 x
1.2.1.1. ハードウェアの要件 1.2.1.2. ソフトウェアの要件
1. AN 923: インテル® Stratix® 10 HPSペリフェラルのFPGAファブリックへの配線

1.1. FPGAへの配線をサポートしている インテル® Stratix® 10 HPSペリフェラル

次のタイプの インテル® Stratix® 10 HPSペリフェラルは、FPGAファブリックに配線できます。

  • Secure Digital/Multimedia Card (SD/MMC)
  • Ethernet Media Access Controller (EMAC)
  • Serial Peripheral Interface (SPI)
  • Universal Asynchronous Receiver/Transmitter (UART)
  • Inter-Integrated Circuit (I2C)
  • NAND Flash Controller
  • TRACE Interface

多くの場合、HPS IP信号をFPGA外部インターフェイスに配線すると、より多くの信号を公開できます。

表 1.  HPSドメインからFPGAドメインへの信号配線をサポートしているペリフェラル次の表では、IPインターフェイスがHPSドメインとFPGAドメインのどちらにピン配置されているかに応じて使用できるインターフェイスのタイプを一覧表示します。
ペリフェラル インターフェイスの説明

HPSドメイン

FPGAドメイン
SD/MMC 最大8ビットのデータバスを備えた標準のSD/MMCインターフェイス 以下を含む標準のSD/MMCインターフェイス
  • 最大8ビットのデータバス
  • カード検出インターフェイス
  • カード割り込み
  • 電圧切り替え
  • 電源イネーブル
  • リセット 1

EMAC

RMIIおよびRGMIIインターフェイス

MII、GMII、RMII、RGMII、SGMII

SPI Master

シングルまたはデュアルスレーブにコンフィグレーション可能なMOSI/MISO SPIインターフェイス

最大4つのスレーブをサポートする出力イネーブルを備えたMOSI/MISO SPIインターフェイス。エクスポートされた信号を双方向バッファーに接続することで実現されるインターフェイスです。

SPI Slave

シングルマスターにコンフィグレーション可能なMOSI/MISO SPIインターフェイス

出力イネーブルを備えたシングルマスターにコンフィグレーション可能なMOSI/MISO SPIインターフェイス

UART

フロー制御信号を備えた標準UARTインターフェイス

DSR、DCD、RI、DTRなどのフロー制御信号を備えた標準UARTインターフェイス。2つのユーザー定義の出力信号も使用可能です。

I2C

標準のI2Cインターフェイス

エクスポートされた信号を双方向バッファーに接続することで実現される標準のI2Cインターフェイス

NAND Flash Controller 8ビットまたは16ビットのデータと1セットのCEおよびR/B信号を備えた標準NANDインターフェイス 8ビットまたは16ビットのデータと4セットのCEおよびR/B信号を備えた標準NANDインターフェイス
TRACE TRACEデバッグ・インターフェイス TRACEデバッグ・インターフェイス

上記のペリフェラル信号インターフェイスの説明については、Intel Stratix 10 Hard Processor System Technical Reference Manualの関連する章を参照してください。

関連情報
1 SD/MMCコントローラーは、リセット、電圧切り替え、カード割り込み、電源イネーブル、または書き込み保護機能を直接サポートしていません。ただし、これらの信号を汎用I/O (GPIO) に接続することは可能です。
レベル 2 の表題