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1.1. リモート・アップデートの Intel® FPGA IPコアでのAvalon®-MM
1.2. インテルArria 10およびインテルCyclone® 10 GXデバイス
1.3. Arria II、 Arria V、 Cyclone V、 Stratix IV、および Stratix Vデバイス
1.4. Cyclone IVおよびインテルCyclone 10 LPデバイス
1.5. フラッシュ・メモリー・プログラミング・ファイル
1.6. デザイン・サンプル
1.7. リモート・アップデート の Intel® FPGA IP ユーザーガイドアーカイブ
1.8. リモート・アップデートの Intel® FPGA IPユーザーガイドの改訂履歴
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1.4.7.3. ソースマッピングの読み出し
レジスター名 | アドレス・オフセット | ソース値の読み出し |
---|---|---|
RU_MASTER_SM_CURRENT_STATE_MODE | 0x0 0x1 0x2 0x3 |
00 01 10 11 |
RU_FORCE_EARLY_CONF_DONE | 0x4 0x5 0x6 0x7 |
00 01 10 11 |
RU_WATCHDOG_TIMEOUT | 0x8 0x9 0xA 0xB |
00 01 10 11 |
RU_WATCHDOG_ENABLE | 0xC 0xD 0xE 0xF |
00 01 10 11 |
RU_BOOT_ADDRESS | 0x10 0x11 0x12 0x13 |
00 01 10 11 |
RU_FORCE_INTERNAL_OSC | 0x14 0x15 0x16 0x17 |
00 01 10 11 |
RU_RECONFIG_TRIGGER_CONDITIONS | 0x18 0x19 0x1A 0x1B |
00 01 10 11 |
RU_RESET_TIMER | 0x1C | N/A |
RU_RECONFIG | 0x1D | N/A |