インテル® FPGA Serial Lite III ストリーミング IP
インテル® FPGA Serial Lite III ストリーミング Intellectual Property (IP) コアは、さまざまなトランスミッション・メディアでポイントツーポイントのデータ転送を実現するシンプルな接続 (プリント回路基板 (PCB)、バックプレーン、銅線ケーブル、光ファイバーなどを含む) を実現します。
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インテル® FPGA Serial Lite III ストリーミング IP
Serial Lite III は、高帯域幅のシリアルデータ転送アプリケーション向けの、シンプルで低レイテンシー、かつスケーラブルなプロトコルです。
インテル® FPGA Serial Lite III ストリーミング IP コアは、インテルのトップ・テクノロジーを組み込んだトランシーバーを備えています。
- 物理媒体アタッチメント (PMA)
- 物理コーディング・サブレイヤー (PCS)
- メディア・アクセス・コントロール (MAC) 層
PCS 層と PMA 層は、インテル® Stratix® 10、インテル® Arria® 10、Stratix® V、および Arria® V FPGA 内でハード化されているため、お客様の貴重な FPGA ロジックリソースを節約できます。
機能
ハード化された PCS / PMA 機能により、どのようなタイプのデザインでもタイミング・クロージャーがより容易になります。Serial Lite III プロトコルは、効率的なデータ転送を実現し、ビットエラーレートを低く保つという今の次世代型システムの要求に応えるため、必要とされる信頼性、低レイテンシー、オーバーヘッド、およびスケーラビリティーを提供するように設計されています。
- 最大 28Gbps のデータレート
- 最大 24 のマルチレーン構成
- データ・ストリーミング・オペレーション - コンティニュアスまたはバースト
- シンプレックスおよび全二重のオペレーション
- 柔軟なユーザー・クロッキング・モード
- ハード化されたリソースにより、使用を効率化
- 低レイテンシーのデータ転送 (< 150 ns: TX + RX)
- 転送オーバーヘッドを最小限に抑制
- 64B / 67B のエンコード / デコードスキーム
- (オプション) M20K (SEU 緩和) でエラー訂正コード (ECC) をサポート
- (オプション) エラーのインジェクションや検出、および健全性監視
- IP の完全統合 (MAC、PCS、PMA 層)
- 調整可能なプリエンファシスおよびイコライゼーション設定
- AC および DC カップリングのサポート
性能と生産性の改善
パフォーマンス |
生産性 |
|---|---|
高効率のデータレート |
適切な IP タイミングマージンで、フルデザインのタイミング・クロージャーを加速 |
使用中のアプリケーションと今後使用するアプリケーション向けに 300Gbps を超える合計帯域幅を実現 (最大 24 レーン) |
インテル® FPGA IP 評価モードを利用することで、無償かつライセンスなしで IP の試用が可能 |
低レイテンシーのデータ転送 (< 150 ns: TX + RX) |
完全に統合された Serial Lite III IP は、MAC 層、PCS 層、および PMA 層を備え、インテル® FPGA IP との統合を実現 |
AC および DC のカップリングにより、レーンを調整してビット・エラー・レートを向上するという柔軟性を実現 |
インテル® Quartus® Prime 開発ソフトウェアでボタンを押すだけでハードウェアを設計する例
関連リンク
ドキュメント
- インテル® Arria® 10 および V シリーズインテル® FPGA 向けのインテル® FPGA Serial Lite III ストリーミング IP 機能のクロッキングに関するガイドライン ›
(このドキュメントにアクセスするには、地域のインテル® FPGA 営業担当者に連絡してください)
- インテル® Arria® 10 および V シリーズインテル® FPGA 向けのインテル® FPGA Serial Lite III ストリーミング IP 機能のデータ効率化計算ツール ›
(このドキュメントにアクセスするには、地域のインテル® FPGA 営業担当者に連絡してください)
その他のリソース
IP のご紹介
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テクニカルサポート
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