記事 ID: 000083091 コンテンツタイプ: トラブルシューティング 最終改訂日: 2018/06/15

インテル® FPGA PCIe* IP が一部のシステムでリンク・トレーニングに失敗するのはなぜですか?

環境

  • V シリーズ Avalon-MM DMA の PCI Express*
  • インテル® Arria® 10 Cyclone® 10 PCI Express* のハード IP
  • Arria® V PCI Express* のハード IP インテル® FPGA IP
  • Avalon-MM Arria® V PCI Express* のハード IP インテル® FPGA IP
  • Arria® V GZ PCI Express* のハード IP インテル® FPGA IP
  • Avalon-MM Arria® V GZ PCI Express* のハード IP インテル® FPGA IP
  • Cyclone® V PCI Express* のハード IP インテル® FPGA IP
  • Avalon-MM Cyclone® V PCI Express* のハード IP インテル® FPGA IP
  • PCI Express* 用 IP_Compiler
  • Stratix® V SR-IOV 搭載 PCI Express* のハード IP インテル® FPGA IP
  • Stratix® V PCI Express* のハード IP インテル® FPGA IP
  • Avalon-MM Stratix® V PCI Express* のハード IP インテル® FPGA IP
  • Avalon-ST インテル® Stratix® 10 PCI Express* のハード IP
  • Avalon-MM インテル® Stratix® 10 PCI Express* のハード IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    PCIe* カード存在信号(PRSNT1_N、PRSNT2_N_X1、PRSNT2_N_X4、PRSNT2_N_X8、PRSNT2_N_X16)は、一部のスマート・ホスト・システムで正しく設定する必要があります。PCIe* リンクが正しくトレーニングされない場合があります。

    例えば、一部のシステムでは、そのスロットの現在の信号で示されているレーン数へのリンク・トレーニングのみを試みます。そのため、現在の信号がいずれも有効になっていない場合、カードは全くトレーニングを行わない可能性があります。例えば x1 存在する信号のみが有効になっている場合、x4、x8、x16 の実装では x1 インターフェイス構成としてのみトレーニングできます。

    解決方法

    この問題はホストシステムと BIOS に依存します。システムによっては、これらの信号を無視する場合があります。ハードウェアで PRSNT 信号が有効になっていることを確認します。インテル® FPGA Development Kits使用時には、通常は DIP スイッチを使用して PRSNT 信号を選択できます。

    関連製品

    本記事の適用対象: 18 製品

    インテル® Stratix® 10 FPGA & SoC FPGA
    Stratix® V GX FPGA
    Stratix® V GT FPGA
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    Stratix® IV GX FPGA
    Stratix® IV GT FPGA
    Stratix® II GX FPGA
    Stratix® GX FPGA
    インテル® Arria® 10 FPGA & SoC FPGA
    Arria® V FPGA & SoC FPGA
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    Cyclone® V GX FPGA
    Cyclone® V GT FPGA
    Cyclone® V SX SoC FPGA
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