記事 ID: 000082877 コンテンツタイプ: トラブルシューティング 最終改訂日: 2013/03/11

プラットフォーム・デザイナーで HPS で DDR3 UniPHY ベースのコントローラーをコンパイルする際にエラーが表示されるのはなぜですか?

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

プラットフォーム・デザイナーで、ハード・プロセッサー・システム (HPS) を搭載した DDR3 UniPHY ベースのコントローラーの 分析および合成 のコンパイル段階で、以下のエラーが表示される場合があります。

エラー: 入力ポート DATAIN on atom "{hierarchy}.config_1"は、cyclonev_io_configプリミティブであり、合法的に接続および/ または構成されていません
情報 (129003): 入力ポート DATAIN は定数信号で駆動されますが、コンパイラーはこの入力ポートを実際の信号に接続することを期待します。


エラー: atom "{hierarchy}.config_1"の入力ポート ENA は、cyclonev_io_config プリミティブであり、合法的に接続および / または構成されていません
情報 (129003): 入力ポート ENA は定数信号で駆動されますが、コンパイラーはこの入力ポートを実際の信号に接続することを期待しています


エラー: 入力ポート UPDATE on atom "{hierarchy}.config_1"は、cyclonev_io_config プリミティブであり、合法的に接続および / または構成されていません
情報 (129003): 入力ポート UPDATE は定数信号で駆動されますが、コンパイラーはこの入力ポートが実際の信号に接続されることを期待しています

解決方法

この問題は、コンパイル中に DDR3 コントローラーがオンザフライで生成される、プラットフォーム・デザイナーの遅延生成を使用する場合に発生します。デザインを適切にコンパイルする正しい方法は、以下のとおりです。

  1. プラットフォーム・デザイナー・システムを作成します。
  2. プラットフォーム・デザイナー・システムで、DDR3 コントローラー IP を 生成 します。
  3. 結果として得られた .qip ファイルを .qsys ファイルではなく、プロジェクト・ファイルに含めます。

関連製品

本記事の適用対象: 6 製品

Cyclone® V SX SoC FPGA
Cyclone® V GX FPGA
Arria® V SX SoC FPGA
Cyclone® V ST SoC FPGA
Arria® V ST SoC FPGA
Cyclone® V SE SoC FPGA

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