回避策はありません。altera.com 上の既存の Verilog HDL デザイン例を参照して、独自の VHDL シミュレーションを作成する必要があります。
環境
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細
SerialLite II IP コア・オン・altera.com(http://www.altera.com/support/examples/interfaces-peripherals/exm-seriallite-stratix-v.html)のデザイン例は、verilog シミュレーションでのみサポートされています。VHDL のデザイン例をシミュレートすると、問題が発生する可能性があります。
解決方法