インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション 19.4 以前のバージョンで既知の問題のため、JESD204C インテル® FPGA IPの制御ビット (CS) の範囲は 0 ~ 31 です。ただし、サポートされている範囲は 0 ~ 3 です。
JESD204C インテル® FPGA IPを使用する場合は、0 ~ 3 範囲内の制御ビット (CS) を選択します。この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 20.1 以降修正されています。