記事 ID: 000077023 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

JESD204C でサポートされている制御ビット (CS) の範囲インテル® FPGA IP正しいですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    JESD
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション 19.4 以前のバージョンで既知の問題のため、JESD204C インテル® FPGA IPの制御ビット (CS) の範囲は 0 ~ 31 です。ただし、サポートされている範囲は 0 ~ 3 です。

解決方法

JESD204C インテル® FPGA IPを使用する場合は、0 ~ 3 範囲内の制御ビット (CS) を選択します。この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 20.1 以降修正されています。

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本記事の適用対象: 4 製品

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