記事 ID: 000076253 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/27

PCI express* で生成されたデザイン例に対する、インテル® FPGA P タイル Avalon® メモリー・マップド (Avalon-MM) IP の DMA テストでホストシステムがハングアップするのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • Avalon-MM インテル® Stratix® 10 PCI Express* のハード IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 19.4 の問題により、PCI express* で生成されたサンプルデザイン用の P タイル・メモリー・マップド (Avalon-MM) IP Avalon® のインテル® FPGA P タイル・メモリー・マップド (Avalon-MM) IP の DMA テストを実行する際に、上記の問題が発生する可能性があります。

    解決方法

    この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 20.1 で修正されています。

    関連製品

    本記事の適用対象: 2 製品

    インテル® Stratix® 10 DX FPGA
    インテル® Agilex™ 7 FPGA & SoC FPGA F シリーズ

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