記事 ID: 000075422 コンテンツタイプ: トラブルシューティング 最終改訂日: 2018/04/30

Stratix® 10 100G イーサネット・ソフト IP コアが ES デバイスのタイミング・クロージャーに失敗するのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    Arria® 10 および Stratix® V 向け低レイテンシー 100G イーサネット・インテル® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT

クリティカルな問題

詳細

1SG280HU2F50E2VGS1 などの非生産 (ES) Stratix® 10 デバイスの場合、すべてのシードでタイミング・クロージャーが達成されない場合があります。

解決方法

タイミング収束を達成するためにシードスイープしてください。

関連製品

本記事の適用対象: 1 製品

インテル® Stratix® 10 GX FPGA

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