記事 ID: 000075173 コンテンツタイプ: エラーメッセージ 最終改訂日: 2021/08/28

エラー (10170): Verilog HDL 構文エラー時 <verilog_file>テキスト "," 付近の .v (line_number)劌卉</verilog_file>

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

Quartus® II ソフトウェアのバージョン 13.1 以降の問題により、ブロックデザインファイル () から変換された Verilog HDL ファイルをコンパイルすると、次のエラーが表示される場合があります。bdf)

エラーの原因は、生成された Verilog HDL ファイルにポート接続に追加のコンマが含まれているためです。

解決方法

このエラーを回避するには、< Verilog_file >.v(line_number)の余分なコンマを手動で削除してください。

この問題は、インテル® Quartus® II ソフトウェアの今後のリリースで修正される予定です。

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