記事 ID: 000074207 コンテンツタイプ: 製品情報 & ドキュメント 最終改訂日: 2021/08/28

Stratix V/Arria V/Cyclone V トランシーバー・デバイスでプリ CDR またはポスト CDR リバース・シリアル・ループバックを無効にする方法

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

プリ CDR またはポスト CDR リバース・シリアル・ループバックは、プリ CDR またはポスト CDR リバース・シリアル・ループバック PMA オフセット・レジスターに 0 を書き込むことで、Stratix® V、Arria® V、およびCyclone® V トランシーバー・デバイスで無効にすることができます。

関連製品

本記事の適用対象: 12 製品

Stratix® V GX FPGA
Cyclone® V SX SoC FPGA
Stratix® V FPGA
Cyclone® V GT FPGA
Stratix® V GT FPGA
Cyclone® V GX FPGA
Stratix® V GS FPGA
Arria® V GZ FPGA
Arria® V SX SoC FPGA
Arria® V ST SoC FPGA
Cyclone® V ST SoC FPGA
Arria® V GX FPGA

ご質問はこちらへ

サポートに問い合わせる

免責事項

1

本サイトでのすべてのコンテンツの投稿および使用には、Intel.com の利用規約が適用されます。

このページのコンテンツは、元の英語のコンテンツを人力翻訳および機械翻訳したものが混在しています。この内容は参考情報および一般的な情報を提供するためものであり、情報の正確さと完全性を保証するものではありません。インテルは不正確な翻訳があった場合でもいかなる責任を負いません。このページの英語版と翻訳の間に矛盾がある場合は、英語版に準拠します。 このページの英語版をご覧ください。