Stratix® V GT トランシーバー・シグナル・インテグリティー開発キット

Stratix® V GT トランシーバー・シグナル・インテグリティー (SI) 開発キットは、電気的コンプライアンス・テストおよび相互接続性解析のためのプラットフォームを提供します。複数チャネルへのアクセシビリティーにより、SMA や一般的なバックプレーン・コネクターで利用できるトランシーバー・チャネル搭載のシステムに導入されているような、実環境での分析が可能になります。

Stratix® V GT トランシーバー・シグナル・インテグリティー開発キット

この開発キットを使用すると、次のタスクを行うことが可能になります。

  • トランシーバー・リンクのパフォーマンスを最大 25.70Gbps まで評価
  • 使いやすい GUI による疑似ランダム・バイナリー・シーケンス (PRBS) パターンの生成と確認 (インテル® Quartus® Prime 開発ソフトウェアは必要ありません)
  • 最新のイコライゼーション機能による、最適な符号誤り率 (BER) を得るためのリンク設定の微調整
  • ジッター解析の実行
  • CEI-25/28G、CEI-11G、PCI Express* (PCIe) Gen 3.0、10GBASE-KR、10 ギガビット・イーサネット、XAUI、CEI-6G、Serial RapidIO®、HD-SDI などの対象プロトコル向けの Stratix® V GT FPGA により、フィジカル・メディア・アタッチメント (PMA) の相互接続性を検証する
  • 内蔵型の高速バックプレーン・コネクターを使用して、カスタム・バックプレーン性能やリンクの BER を評価

表 1.トランシーバー・シグナル・インテグリティー開発キット、Stratix® V GT エディションの注文情報

注文コード 価格 注文情報
DK-SI-5SGTMC7N
 12,995 米ドル トランシーバー・スピード・グレード -3 (GT データレート最大 25.70Gbps)
北米で発注する場合は、1-888-800-0631 にお電話いただくか、お近くの販売代理店にお問合せください。
国際的な販売については、お近くのディストリビューターにお問い合わせください。
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注意：

ご購入の対象となる方は、製品開発者、ソフトウェア開発者、システム・インテグレーターの方々です。また、この製品が FCC 認定を受けていない開発キットであり、あくまで評価目的およびソフトウェア開発目的にのみ提供されることをご了承ください。再販は認められません。

開発キットの内容

トランシーバー SI 開発キット、Stratix® V GT エディションには次の機能があります。

  • Stratix® V GT 開発ボード
  • 対象デバイス
  • 5SGTMC7K3F40C2N
  • コンフィグレーション・ステータスとセットアップ・エレメント
  • JTAG
  • オンボード USB-BlasterTM
  • インテル® MAX® II デバイスおよびフラッシュメモリーを介したファースト・パッシブ・パラレル (FPP) コンフィグレーション
  • 2 個の構成ファイル・ストレージ
  • 温度計測回路 (ダイ温度と周囲温度)
  • クロック数
  • 50MHz、125MHz のプログラマブル・オシレーター (プリセット値: 624MHz、644.50MHz、706.25MHz、875MHz)
  • トランシーバー・リファレンス・クロックに外部差動クロックを供給するための SMA コネクター
  • FPGA ファブリックに外部差動クロックを供給するための SMA コネクター
  • FPGA のフェーズロック・ループ (PLL) の出力ピンから差動クロックを出力するための SMA コネクター
  • 汎用ユーザー入力 / 出力
  • RJ-45 (銅) コネクター付き 10/100/1000Mbps イーサネット PHY (RGMII)
  • 16x2 キャラクター LCD
  • 1 個の 8 ポジション DIP スイッチ
  • 8 個のユーザーLED
  • 4 個のユーザー用プッシュボタン
  • メモリーデバイス
  • 128 メガバイト (MB) 同期フラッシュメモリー (主に FPGA コンフィグレーションの格納用)
  • 高速シリアル・インターフェイス
  • MMPX コネクターに配線された 4 個の全二重 GTB (28.05Gbps) トランシーバー・チャネル
  • SMA コネクターに配線された 7 個の全二重 GXB (12.5Gbps) トランシーバー・チャネル
  • マイクロストリップの短い配線
  • 6 個のストリップライン・チャネル (すべての配線長がチャネル間で一致)
  • バックプレーン・コネクターに配線された 21 個の全二重 GXB トランシーバー・チャネル
  • Molex* Impact* コネクターへの 7 個のチャネル
  • Amphenol* XCede* への 7 個のチャネル
  • Tyco Strada* Whisper* のフットプリントへの 7 個のチャネル (コネクターは実装されていません）
  • 電源
  • ラップトップ DC 入力
  • 電圧マージニング
  • Stratix® V GT トランシーバー SI 開発キットのソフトウェアの内容
  • インテル® FPGA のコンプリート・デザイン・スイート (インテル® FPGA ダウンロード・センターからダウンロード)
  • インテル® Quartus® Prime 開発ソフトウェアには Stratix® V FPGA のサポートが含まれています。
  • 1 年間のライセンス付き
  • Nios® II エンベデッド・デザイン・スイート
  • MegaCore® intellectual property (IP) ライブラリーには、PCIe、トリプルスピード・イーサネット、シリアル・デジタル・インターフェイス (SDI)、およびDDR3 SDRAM 高性能コントローラー MegaCore IP コアを含みます
  • OpenCore Plus による IP 評価が利用可能
  • ボード・アップデート・ポータル
  • Nios* II ウェブ・サーバーとリモート・システム・アップデートを装備
  • GUI ベースのボード・テスト・システム
  • JTAG 経由による PC へのインターフェイス
  • ユーザーによるコントロールが可能な PMA 設定 (プリエンファシス、イコライゼーションなど)
  • ステータス表示 (エラー、BER など)
  • ドキュメント一式
  • ユーザーガイド
  • リファレンス・マニュアル
  • ボード回路図とレイアウト設計ファイル

表2.トランシーバー開発キット、Stratix® V GT エディションの資料

ドキュメント

詳細

バージョン

トランシーバー・シグナル・インテグリティー開発キット、Stratix® V GT エディションのユーザーガイド (PDF)

トランシーバー SI 開発キットの設定および付属ソフトウェアの使用に関する情報。

1.1

トランシーバー・シグナル・インテグリティー開発キット、Stratix® V GT エディションのリファレンス・マニュアル (PDF)

ボード・コンポーネントとインターフェイスに関する詳細情報。

1.1

キットのファイル (Zip)

リファレンス・マニュアル、ユーザーガイド、クイック・スタート・ガイド、BOM、レイアウト、PCB、回路図、ボード・アップデート・ポータルのサンプルファイルなど、開発キットに含まれるすべてのファイルの Zip パッケージ。

12.1.1.0
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