記事 ID: 000099036 コンテンツタイプ: トラブルシューティング 最終改訂日: 2024/06/14

シミュレーション・オプションを有効にした F タイル DisplayPort FPGA IP デザイン例の生成が失敗するのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    DisplayPort*
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

Quartus® Prime 開発ソフトウェア・プロ・エディション v23.4 以前の問題により、シミュレーションを有効にした F タイル DisplayPort FPGA IP デザイン例を正常に生成できません。

解決方法

F タイル DisplayPort FPGA IP デザイン例を生成する際に、シミュレーション・オプションを選択しないでください。デザイン例は、シミュレーション・オプションがなくても正常に生成できます。

この問題は、Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 24.1 で修正されています。

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