記事 ID: 000097739 コンテンツタイプ: トラブルシューティング 最終改訂日: 2024/06/18

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 23.3 のシステム列挙で、Compute Express Link* (CXL*) タイプ 3 のデザイン例の R タイル FPGA IP が失敗するのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション

OS Independent family

BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 23.3 の問題により FPGA 、「lspci |Linuxコマンドラインでgrep 0ddb」をクリックします。

解決方法

この問題は、Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 23.4 で修正されています。

関連製品

本記事の適用対象: 1 製品

インテル® Agilex™ 7 FPGA & SoC FPGA I シリーズ

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