記事 ID: 000096693 コンテンツタイプ: トラブルシューティング 最終改訂日: 2023/10/10

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 23.2 で PCI Express* のデザイン例で F タイル・マルチチャネル DMA インテル® FPGA IPを生成できないのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 23.2 の問題により、PCI Express* の F タイル・マルチチャネル DMA インテル® FPGA IPに 1x4 エンドポイント・モードを使用すると、デザイン生成のエラー例が表示されることがあります。

解決方法

この問題を回避するには、「シミュレーション」オプションのチェックマークを外してサンプルデザインを生成します。

この問題は、インテル® Quartus® Prime Pro Edition ソフトウェアのバージョン 23.3 で修正されました。

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本記事の適用対象: 1 製品

インテル® Agilex™ 7 FPGA & SoC FPGA I シリーズ

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