記事 ID: 000094752 コンテンツタイプ: トラブルシューティング 最終改訂日: 2023/10/12

F タイル・イーサネット・インテル® FPGA Hard IPのデザイン例で「パケット・クライアント・ループバック」が有効になっているのに、リンクパートナーまたはイーサネット・テスターで FCS または CRC エラーが表示されるのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime Pro Edition ソフトウェア・バージョン 23.1 の問題により、F タイル・イーサネット・インテル® FPGA Hard IPのデザイン例で「パケット・クライアント・ループバック」が有効になっている場合、リンクパートナーまたはイーサネット・テスターで FCS または CRC エラーが表示されることがあります。

    解決方法

    この問題を回避するには、cfg_rom_pkt_gap_addr (オフセット 0x1C) レジスタに 32'h0000_0000 を書き込みます。シングル IP インスタンスのデザイン例では、このレジスターは絶対オフセット 0x0010_001Cにあります。
    この問題は、インテル® Quartus® Prime Pro Edition ソフトウェアのバージョン 23.2 以降で修正されています。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Agilex™ FPGA & SoC FPGA

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