記事 ID: 000094002 コンテンツタイプ: トラブルシューティング 最終改訂日: 2023/12/11

クロックド・ビデオ・インターフェイスの固定レートリンク (FRL) および遷移最小化差動信号 (TMDS) モードを備えた F タイル HDMI インテル® FPGA IPのデザイン例が機能しないのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • HDMI*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 22.4 の問題により、SystemPLL IP を変更すると、 rx_tmds_clk が低く切り替わらない / 低いままにならないことがありました。

    このクロックが正しく動作していないと、遷移最小差動信号 (TMDS) モードは機能しません。

    解決方法

    インテル® Quartus® Prime Pro Edition ソフトウェア・バージョン 22.4 でこの問題を修正するパッチが利用可能です。

    以下のリンクからパッチ 0.04 をダウンロードしてインストールします。

    この問題は、インテル® Quartus® Prime Pro Edition ソフトウェアの今後のリリースで修正される予定です。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Agilex™ 7 FPGA & SoC FPGA F シリーズ

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