記事 ID: 000092786 コンテンツタイプ: トラブルシューティング 最終改訂日: 2022/12/14

PCI Express* 向け P タイル・Avalon・ストリーミング・インテル® FPGA IP®を使用する際、なぜリムーバル・タイミング違反が生じますか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • インターフェイス
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 22.2 の問題により、PCI Express* 向け P タイル®・Avalon・ストリーミング・インテル® FPGA IPを使用すると 、「*|intel_pcie_ptile_ast_0|soft_logics|rst_ctrl|p*_reset_status_s_q」からの 削除タイミング違反が発生する可能性があります。

    解決方法

    この問題は、バージョン 22.3 以降インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションで修正されています。

    関連製品

    本記事の適用対象: 2 製品

    インテル® Stratix® 10 DX FPGA
    インテル® Agilex™ F シリーズ FPGA および SoC FPGA

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