記事 ID: 000092175 コンテンツタイプ: トラブルシューティング 最終改訂日: 2023/08/18

Interlaken (第 2 世代) インテル FPGA IPは何レーンをサポートしていますか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    Interlaken (第 2 世代) インテル® FPGA IP
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime Pro Edition ソフトウェア・バージョン 22.2 以前の問題により、パラメーター「レーン数」の「4、6、8、10、12、および 24 の構成をサポート」というコメントが正しくありません。レーンの最大数は 12 である必要があります。

解決方法

この問題は、インテル® Quartus® Prime Pro Edition ソフトウェア 22.4 で修正されています。

関連製品

本記事の適用対象: 5 製品

インテル® Agilex™ 7 FPGA & SoC FPGA F シリーズ
インテル® Stratix® 10 GX FPGA
インテル® Stratix® 10 MX FPGA
インテル® Stratix® 10 SX SoC FPGA
インテル® Stratix® 10 TX FPGA

1

ご質問はこちらへ

サポートに問い合わせる

免責事項

1

本サイトでのすべてのコンテンツの投稿および使用には、Intel.com の利用規約が適用されます。

このページのコンテンツは、元の英語のコンテンツを人力翻訳および機械翻訳したものが混在しています。この内容は参考情報および一般的な情報を提供するためものであり、情報の正確さと完全性を保証するものではありません。インテルは不正確な翻訳があった場合でもいかなる責任を負いません。このページの英語版と翻訳の間に矛盾がある場合は、英語版に準拠します。 このページの英語版をご覧ください。