記事 ID: 000091193 コンテンツタイプ: トラブルシューティング 最終改訂日: 2023/01/09

「50GE-2」、「MII PCS のみ」、「なし」の FEC モードのオプションが選択されている F タイル・イーサネット・インテル® FPGA Hard IPを実装する際、サポートロジック生成エラーが表示されるのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    インターフェイス
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 22.1 の問題により、「50GE-2」、「MII PCS のみ」および「なし」FEC モード・オプションが選択された F タイル・イーサネット・インテル FPGA Hard IPを実装すると、サポートロジック生成エラーが発生する可能性があります。

バージョン 21.4 以前のインテル® Quartus® Prime 開発ソフトウェア・プロ・エディションは影響を受けません。

解決方法

この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 22.2 以降で修正されています。

関連製品

本記事の適用対象: 1 製品

インテル® Agilex™ 7 FPGA & SoC FPGA I シリーズ

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