記事 ID: 000090637 コンテンツタイプ: エラッタ 最終改訂日: 2023/01/11

PTP が有効で FEC が有効でない F タイル・イーサネット・マルチレート・インテル® FPGA IP 100GE-4 プロファイルが、シミュレーションでo_p0/p1/p2/p3_rx_ptp_readyのアサートに失敗する理由とは?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    インターフェイス
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 22.1 の問題により、PTP が有効で FEC が有効でない F タイル・イーサネット・マルチレート・インテル® FPGA IP 100GE-4 プロファイルは正しく機能せず、rx_ptp_ready ポートはアサートに失敗します。

解決方法

22.1 には、この問題の回避策はありません。
この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションの今後のリリースで修正される予定です。

関連製品

本記事の適用対象: 1 製品

インテル® Agilex™ 7 FPGA & SoC FPGA I シリーズ

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