記事 ID: 000088714 コンテンツタイプ: エラーメッセージ 最終改訂日: 2023/06/05

インテル Agilex® 7 F タイル SDI II FPGA IP デザイン例がサポートロジック生成ステージでコンパイルできないのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    インターフェイス
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション v21.4 の問題により、インテル Agilex® 7 F タイル SDI II FPGA IP のデザイン例は、コンパイル中のサポートロジック生成ステージで以下のエラーメッセージで失敗します。

エラー (21842): デザインで使用されている IP コンポーネントの設定が競合しているため、サポートロジックを生成できません。

解決方法

インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 21.4 でこの問題を解決するパッチが利用可能です。

以下のリンクからパッチ 0.01 をダウンロードしてインストールします。

この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション バージョン 22.1 以降で修正されています。

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インテル® Agilex™ FPGA & SoC FPGA

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