記事 ID: 000086930 コンテンツタイプ: トラブルシューティング 最終改訂日: 2018/07/26

デザイン例のAvalon・コントローラーが、インテル® Arria®10 PHYLite IP への間違った書き込みアドレスを生成し、ダイナミック・リコンフィグレーションに失敗する原因となるのはなぜですか?

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    パラレル・インターフェイスの PHY Lite インテル® Stratix® 10 FPGA
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

Avalon・コントローラーで インテル® Arria® 10 PHYLite サンプルデザインを使用すると、間違ったアドレスオフセットが生成されます。

 

解決方法

この問題は、インテル Quartus® Prime ソフトウェアの今後のリリースで修正される予定です。

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本記事の適用対象: 1 製品

インテル® Arria® 10 FPGA & SoC FPGA

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