記事 ID: 000086767 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/12

EMIF トラフィック・ジェネレーター 2.0 アイドル・サイクル・カウントとループ・アイドル・カウンターに不一致があるのはなぜですか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
  • 外部メモリー・インターフェイス・インテル® Stratix® 10 FPGA IP
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディションのバージョン 20.4 以前の問題により、EMIF トラフィック・ジェネレーター 2.0 (TG2) の連続するループ間のアイドルサイクル数は、読み出しまたは書き込みの数が 1 の場合、ループ・アイドル・カウンターと等しくなりません。この問題は、ループ・アイドル・カウンターの再読み込みが誤って実行されるため、ループ数が 2 より多い場合にのみ発生します。ループ間のアイドルサイクル数は、ループ・アイドル・カウンターより 1 つ少なくなります。

    解決方法

    この問題は、インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション・バージョン 21.1 以降で修正されています。

    関連製品

    本記事の適用対象: 2 製品

    インテル® Agilex™ FPGA & SoC FPGA
    インテル® Stratix® 10 FPGA & SoC FPGA

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