記事 ID: 000086464 コンテンツタイプ: トラブルシューティング 最終改訂日: 2018/01/26

cv_5v4 Cyclone® V ハード・プロセッサー・システム・テクニカル・リファレンス・マニュアル - > エラッタ

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

cv_5v4 Cyclone® Vハードプロセッサシステムテクニカルリファレンスマニュアルのバージョン2018.01.26では、22〜53ページにCPRレジスタビット23:16の説明とリセット値が誤って示されています。これらのビットの正しいリセット値は 0x08 で、FIFO 深度は 128 バイトであることを表します。

解決方法

このエラーは、テクニカル・リファレンス・マニュアルの今後のリリースで修正される予定です。

関連製品

本記事の適用対象: 1 製品

Cyclone® V FPGA & SoC FPGA

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