記事 ID: 000086378 コンテンツタイプ: トラブルシューティング 最終改訂日: 2019/03/15

Arria® 10 のクロック・マネージャーでhmc_pll_ref_clkを EMIF の基準クロックとして使用できますか?

環境

  • インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    いいえ、FPGA I/O に基準クロックを入力する必要があり 、インテル Arria 10 GX、GT、SX デバイスファミリーのピン接続ガイドラインに従う必要があります。

    解決方法

    インテル Arria 10 ハード・プロセッサー・システム・テクニカル・リファレンス・マニュアルは、今後のリリースで更新される予定です。

    関連製品

    本記事の適用対象: 1 製品

    インテル® Arria® 10 SX SoC FPGA

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