記事 ID: 000086191 コンテンツタイプ: トラブルシューティング 最終改訂日: 2013/01/15

40nm デバイスにおけるシリアル・デジタル・インターフェイス I デザインの長いロック時間

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT

クリティカルな問題

詳細

デザインに長いロック機能があるシリアル・デジタル・インターフェイス (SDI) 高解像度 (HD) から第 3 世代に切り替える際の時間 (3G) または 3G を受信した後にコアがリセットされた場合。

フレームロックを実現するには、設計に時間がかかる場合があります。 レート検出ブロックが標準を正しく検出できないのは、 レート検出中に復元されたデータが正しくありません。

この問題は、40nm デバイスの SDI I デザインに影響を与えます。

解決方法

この問題の回避策はありません。

この問題は今後修正される予定です。

関連製品

本記事の適用対象: 1 製品

インテル® プログラマブル・デバイス

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