記事 ID: 000085643 コンテンツタイプ: トラブルシューティング 最終改訂日: 2012/11/15

シミュレーションで Tx avalon-st パケットのパリティが悪いと、tx_par_err[1] アサートされないのはなぜですか?

環境

  • インテル® Quartus® II サブスクリプション・エディション
  • PCI Express*
    • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    クリティカルな問題

    詳細

    インテル® Quartus® II ソフトウェア・バージョン 12.0sp2 以前の問題により、PCIe HIP のシミュレーション・モデルは、tx_par_err[0]がパリティーとパケットでアサートされているにもかかわらず、Tx avalon-st パケットの不正なパリティを持つtx_par_err[1] をアサートしません。

    解決方法

    この問題は、インテル® Quartus® ソフトウェア・バージョン 13.1 で修正されています。

    関連製品

    本記事の適用対象: 1 製品

    Stratix® V GX FPGA

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