記事 ID: 000084790 コンテンツタイプ: 製品情報 & ドキュメント 最終改訂日: 2015/12/17

Cyclone V デバイスの差動ピンに対するクロストークと SSN の比率を下げる方法は?

環境

BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

添付 資料 では、インテル® Quartus® II ソフトウェアのディファレンシャル・ピンに対するクロストークの割合 (%) と同時スイッチング・ノイズ (SSN) の割合 (%) (%) を、Cyclone® V デバイスを対象とする方法について説明します。

 

解決方法

 

関連製品

本記事の適用対象: 6 製品

Cyclone® V SX SoC FPGA
Cyclone® V GT FPGA
Cyclone® V GX FPGA
Cyclone® V ST SoC FPGA
Cyclone® V E FPGA
Cyclone® V SE SoC FPGA

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