このエラーは 、IEEE 標準 Verilog ハードウェア記述言語 セクション 12.4 に従って階層名を使用して Verilog HDL の低レベル信号を参照している場合に表示される場合があります。Quartus® II ソフトウェアは、シミュレーション以外ではこの構文をサポートしていません。
環境
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細
解決方法
このエラーを回避するには、低レベルモジュールの出力ポートリストを変更して信号を直接出力します。