PLL への入力基準クロックが安定していると仮定すると、PLL がロックを確立している間、PLL ロックされた信号は切り替えられません。 Stratix® V、Stratix IV、Stratix III、Arria® 10、Arria V、Arria II、Cyclone® V、Cyclone IV およびCyclone III デバイスの汎用 PLL には、ロックされたポートの切り替えが妨げるハード化されたオファクシス・フィルターが搭載されています。
PLL のロックされたポートは、入力基準クロックへのロック取得処理中に切り替わりますか?
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