記事 ID: 000084375 コンテンツタイプ: トラブルシューティング 最終改訂日: 2015/12/14

RTL とゲート・レベル・シミュレーションで 1 クロックサイクル遅延の違いを確認する理由

環境

    インテル® Quartus® Prime 開発ソフトウェア・プロ・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細 インテル® Quartus® Prime 開発ソフトウェアの V シリーズ・デバイス向け DSP レジスターのパッキングに問題があるため、ゲートレベルの機能シミュレーションにおいて RTL 機能シミュレーションと比較して、レジスターのクロックサイクル遅延の違いが生じる場合があります。
解決方法

この問題を回避するには、フィッター・オプションの「オート・パック・レジスター」を「自動」から (デフォルト)「オフ」に変更するか、Quartus® II ソフトウェア・バージョン 15.0.2 のパッチをダウンロードしてください。

 

この問題は、インテル® Quartus® Prime 開発ソフトウェアのバージョン 15.1 Update 1 以降修正されています。

 

関連製品

本記事の適用対象: 15 製品

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Stratix® V GS FPGA
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