記事 ID: 000083851 コンテンツタイプ: トラブルシューティング 最終改訂日: 2014/04/04

複数の MPFE ポートを備えたハード・メモリー・コントローラーを使用する際、読み込みデータが正しく表示されないのはなぜですか?

環境

  • インテル® Quartus® II サブスクリプション・エディション
  • UniPHY インテル® FPGA IP 搭載 DDR3 SDRAM コントローラー
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    ハード・メモリー・コントローラー (HMC) MPFE ポートに対して書き込みおよび読み取りトランザクションを実行する場合、書き込み優先順位が高い場合でも、読み取りトランザクションが書き込みトランザクションの前に実行されることがあります。その結果、読み取ったデータが正しくない可能性があります。

    例えば、HMC MPFE ポートが次のように設定されているとします。

    Port0 は書き込み専用として設定され、プライオリティは 7、ウェイトは 0 に設定
    ポート 1 は読み取り専用、プライオリティは 1、ウェイトは 0 に設定

    ポート 0 でデータ 'data0' で 'addr0' をアドレス指定する書き込み要求と、同時に 'addr0' をアドレス指定する読み取り要求を Port1 で実行する場合、読み戻されたデータは常に 'data0' である必要があります。HMC には、読み出しデータが予期したとおりではないという問題があります。

    解決方法

    回避策は、同じアドレス範囲へのすべての書き込み要求が完了するまで、アドレス範囲に対する読み取り要求の実行を遅らせることです。別の方法は、書き込み先のメモリ領域とは異なるメモリ領域から読み取ることです。

    関連製品

    本記事の適用対象: 11 製品

    Cyclone® V ST SoC FPGA
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