記事 ID: 000083703 コンテンツタイプ: トラブルシューティング 最終改訂日: 2013/09/11

SignalTap II Logic Analyzer を使用する際に、test_out バス上の PIPE インターフェイス信号をキャプチャーするのにどのようなクロックを使用すべきですか?

環境

    PCI Express*
    動作周波数
BUILT IN - ARTICLE INTRO SECOND COMPONENT
詳細

pld8gtxclkoutを使用して、SignalTap™ II ロジック・アナライザーを使用して、test_out・インターフェイス上の PIPE 信号をキャプチャーします。 このクロック信号は、次の階層に配置されています。

Arria® V デバイスファミリーの場合: *xcvr_native|inst_av_pcs|inst_av_pcs_ch*
Stratix® V デバイスファミリーの場合: *xcvr_native|inst_sv_pcs|int_sv_pcs_ch*

関連製品

本記事の適用対象: 11 製品

Cyclone® V SX SoC FPGA
Cyclone® V GT FPGA
Stratix® V GX FPGA
Cyclone® V GX FPGA
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Arria® V GZ FPGA
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Cyclone® V ST SoC FPGA
Arria® V ST SoC FPGA
Arria® V GX FPGA
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