記事 ID: 000083308 コンテンツタイプ: トラブルシューティング 最終改訂日: 2014/02/27

規則 C101: ゲーテッドクロックはAltera標準スキームに従って実装する必要がある

環境

  • インテル® Quartus® II ソフトウェア
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    詳細

    コンパイル済みの HPS デザイン上で Quartus® II ソフトウェアでデザイン・アシスタント・ツールを実行すると、以下の警告が表示される場合があります。

    ルールC101:ゲーテッドクロックはAltera標準スキームに従って実装する必要があります。<hierarchy>:altdq_dqs2_inst|dqsbusout

    解決方法

    この警告は予期されるものであり、無視しても問題ありません。

    関連製品

    本記事の適用対象: 6 製品

    Arria® V GT FPGA
    Cyclone® V SX SoC FPGA
    Cyclone® V ST SoC FPGA
    Cyclone® V SE SoC FPGA
    Arria® V ST SoC FPGA
    Arria® V SX SoC FPGA

    このページのコンテンツは、元の英語のコンテンツを人力翻訳および機械翻訳したものが混在しています。この内容は参考情報および一般的な情報を提供するためものであり、情報の正確さと完全性を保証するものではありません。インテルは不正確な翻訳があった場合でもいかなる責任を負いません。このページの英語版と翻訳の間に矛盾がある場合は、英語版に準拠します。 このページの英語版をご覧ください。