記事 ID: 000082999 コンテンツタイプ: トラブルシューティング 最終改訂日: 2021/08/29

UniPHY 対応 DDR2 および DDR3 SDRAM コントローラー向けStratix V デバイスで非レベル DDR2 トポロジーのタイミングが失敗する

環境

    インテル® Quartus® II サブスクリプション・エディション
BUILT IN - ARTICLE INTRO SECOND COMPONENT

クリティカルな問題

詳細

非レベル・トポロジーが DDR2 プロトコルで動作しない Stratix V デバイスをターゲットにしています。

解決方法

この問題の回避策はありません。

関連製品

本記事の適用対象: 1 製品

Stratix® V FPGA

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